Mehr Rechenleistung für künstliche Intelligenz lässt sich nicht mehr allein durch kleinere Transistoren erreichen. Auf dem North America Technology Symposium am 22. April in Santa Clara hat TSMC gezeigt, wie der weltgrößte Auftragsfertiger diese Grenze umgehen will — mit neuen Packaging-Technologien, einem unerwarteten Prozessknoten und einer klaren strategischen Weggabelung.
Zwei Pfade: Mobil gegen KI/HPC
TSMCs Roadmap bis 2029 offenbart eine bewusste Zweiteilung. Mobile- und Client-Plattformen folgen einer Logik aus Kosteneffizienz, IP-Wiederverwendung und Designkontinuität. KI- und HPC-Chips hingegen brauchen maximale Stromversorgung, hohe Stromdichte und Spitzenleistung — andere Prioritäten, andere Prozesse.
Bemerkenswert: Für keinen einzigen Knoten bis 2029 plant TSMC den Einsatz von High-NA-EUV-Lithographie.
N2U: Plattformerweiterung für 2028
Weniger erwartet war die Ankündigung von N2U, einer Erweiterung der 2-Nanometer-Plattform. Gegenüber N2P soll N2U entweder rund 3 bis 4 Prozent mehr Geschwindigkeit bei gleichem Energieverbrauch liefern oder 8 bis 10 Prozent weniger Stromverbrauch bei gleicher Leistung — bei einer Logikdichte-Verbesserung von etwa 2 bis 3 Prozent. Entscheidend: N2U bleibt IP-kompatibel mit N2P, was den Designaufwand für Kunden begrenzt.
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Der Knoten richtet sich an KI-, HPC- und Mobile-Anwendungen und soll 2028 in Produktion gehen. Das Kalkül dahinter ist Plattformmonetarisierung: TSMC verlängert den wirtschaftlichen Lebenszyklus seiner 2nm-Technologie, ohne Kunden zu einem Neustart zu zwingen.
CoWoS wächst auf 14-Retikel-Größe
Für KI-Chip-Investoren sind die Packaging-Ankündigungen mindestens ebenso relevant. Aktuell fertigt TSMC CoWoS-Pakete in 5,5-Retikel-Größe. Bis 2028 soll die Technologie auf 14 Retikel wachsen — groß genug, um rund zehn große Compute-Dies und 20 HBM-Stacks in einem einzigen Paket zu integrieren.
Analysten erwarten, dass Unternehmen wie Nvidia die größten Leistungsgewinne der kommenden Jahre weniger aus Transistorverkleinerungen ziehen werden als aus genau diesen Packaging-Fortschritten.
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Silizium-Photonik startet 2026
TSMCs Compact Universal Photonic Engine (COUPE) geht noch in diesem Jahr in Produktion. Die Technologie integriert eine optische Engine direkt ins Chip-Paket und erreicht damit gegenüber einer externen Lösung auf der Leiterplatte doppelte Energieeffizienz und zehnfach geringere Latenz. Basis ist ein 200-Gbps-Mikroring-Modulator für die Datenübertragung zwischen Server-Racks in Rechenzentren.
A16 verschiebt sich, N2A kommt für Automotive
A16, TSMCs erster Knoten mit rückseitiger Stromversorgung über Super Power Rail, ist technisch für 2026 bereit. Das Volumen-Ramp liegt jedoch erst 2027 — abhängig von den Hochlaufplänen der Kunden, wie TSMC-Vizepräsident Kevin Zhang erklärte.
Neu angekündigt wurde N2A, der erste Automotive-Prozessknoten mit Nanosheet-Transistoren. Er richtet sich an Fahrerassistenzsysteme und physische KI-Anwendungen wie humanoide Roboter. Bereits mehr als zehn Produkte befinden sich auf Basis des Vorgängers N3A in der Planung.
Rückenwind durch Rekordquartal
Die Symposiums-Ankündigungen kommen unmittelbar nach einem Rekordquartal: Für das Gesamtjahr 2026 erwartet TSMC ein Umsatzwachstum von mehr als 30 Prozent gegenüber dem Vorjahr. Für das zweite Quartal prognostiziert das Unternehmen einen Umsatz zwischen 39 und 40,2 Milliarden US-Dollar — ein sequenzielles Plus von rund 10 Prozent.
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